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http://bbs3.driverdevelop.com/index.php?m=space&uid=34678
谁能救我,VHDL控制程序
我自己编写了好几天了都不对,始终都是READY信号滞后而且读写时读出的数据不正确还有几天就要验收了,调不出来老师不让我毕业阿,现在很急的说那位高人能帮我一下,给我一份好使的程序先,分一定多给万分感激万分感激
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7
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2003-06-21 21:25
来自版块 -
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flying
:
怎么提前啊 如果使用时钟上升沿同步,会导致输出延时一个周期,这样肯定不行,READY和BLAST信号相差很多了,读数全都是FFFF 如果使用时钟下降沿同步,会导致输出延时半个周期,这样也不行,读出来的数据基本上只有一半正确,还有一半都是不对的 也不一定要和PCI9...
(2003-06-23 23:21)
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flying
:
LBRD1 的Bit6 :Memory Space 1 TA#/READY# Input Enable. LBRD0 的Bit6 :Memory Space 0 TA#/READY# Input Enable. 你可以设定的。在PCI9054 DataBook的11-24和1...
(2003-06-23 23:19)
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sandybull
:
怎么提前啊 如果使用时钟上升沿同步,会导致输出延时一个周期,这样肯定不行,READY和BLAST信号相差很多了,读数全都是FFFF 如果使用时钟下降沿同步,会导致输出延时半个周期,这样也不行,读出来的数据基本上只有一半正确,还有一半都是不对的
(2003-06-23 10:19)
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green_pine
:
可以想办法把ready提前
(2003-06-23 10:04)
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sandybull
:
就是9054读写本地端的RAM时,需要使用9054的读写控制信号LW/R,ADS,Blast产生RAM的控制信号例如OE,CS 这里READY是由CPLD产生给9054的,表示本地端准备好 9054的databook中有一个时序图就是9054进行单周期度操作的时候,使用REA...
(2003-06-23 06:38)
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flying
:
Ready#是一个双向的信号,你可以在9054的配置寄存器中设置它的工作方式。是不是你的配置的问题
(2003-06-22 20:22)
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sharc2002
:
请问是控制什么?
(2003-06-22 13:59)
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sandybull
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