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vhdl和verilog hdl有什么区别呀？

大家不要笑我 :)

回复(3) 2004-02-03 09:59 来自版块 - DSP & PLD &FPGA

◆ ◆

: wltt163：vhdl一般用于大系统，很有优势。ｖｅｒｉｌｏｇ　ｈｄｌ则在小规模设计有很大的便捷！(2005-04-30 16:33)

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: vivid3749：是呀是呀(2005-03-26 15:36)

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: amaosonic：verilog更接近c语言风格，比较容易入门一点的吧。vhdl则要详尽和严格一些的了。具体语法和使用方面的差异，那可以等你用到它们时再慢慢体会即可。(2004-02-03 16:51)

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adaizhu

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