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我使用ISE6.3,当我输入一个时钟时，软件就把它作为全局时钟，再布线时报错，要求此时钟的输入引脚为专用时钟引脚，我只能让此时钟引脚为IO口（板子已做），不能让它作为全局时钟，应该怎么设置？谢谢！！

回复(2) 2004-12-15 22:07 来自版块 - DSP & PLD &FPGA

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: pcb_board：如果你所做的板子对延迟要求不是很高的情况下（即，全剧时钟频率不是很高20M以下），你可以用普通的 IO 脚代替全剧时钟管脚，当然你要把你所选的芯片的一个触发器延时考虑到 :)(2004-12-18 23:04)

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: hanchong：我不太清楚你所用的工具，但我原来在maxplus中设计，对cpld分配管脚时，也出现过同样的问题。我当时是把maxplus中的全局设置选项取消后，就可以把专用引脚分配给时钟了。你可以看看你用的软件有没有这个功能。(2004-12-16 11:11)

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