PCI9054不正常？？？

楼主^#

更多发布于：2003-07-15 21:38

我做的PCI9054卡，从前没有焊CPLD，（9054上的大部分LOCAL 控制信号都连在CPLD上，）用PLXomn工具调试，基本都正常，但是焊了CPLD，并且烧写了一些简单逻辑，PLXMON就工做不正常了。请问大侠local bus上什么关键信号对9054 会产生这样的影响？？？
在CPLD 中烧写时，不用的管脚做输入管脚，进行一些不相关的与或运算，应该不影响输入信号吧？？？

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green_pine 驱动太牛注册日期2002-10-22 最后登录2019-06-10 粉丝3 关注0 积分48分威望599点贡献值1点好评度144点原创分0分专家分0分加关注写私信	沙发^# 发布于：2003-07-16 08:07 看一下两个器件的接口电平是否一致
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zhangyanping 驱动小牛注册日期2003-02-23 最后登录2004-07-23 粉丝0 关注0 积分0分威望0点贡献值0点好评度0点原创分0分专家分0分加关注写私信	板凳^# 发布于：2003-07-16 12:28 还有一个就是各个重要的时钟问题了,该有的时钟如局部时钟都是必须的啊
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jiuzhong 驱动牛犊注册日期2003-05-01 最后登录2003-10-07 粉丝0 关注0 积分0分威望0点贡献值0点好评度0点原创分0分专家分0分加关注写私信	地板^# 发布于：2003-07-16 21:44 CPLD和PCI9054的电平都是3.3v的，局部时钟也有信号。局部控制线中那些会对9054的工作产生重大影响？
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flying 驱动小牛注册日期2002-08-01 最后登录2016-06-19 粉丝0 关注0 积分197分威望70点贡献值0点好评度19点原创分0分专家分0分加关注写私信	地下室^# 发布于：2003-07-16 23:23 你以前没有焊CPLD是怎么工作的？能否说得更明白些
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jiuzhong

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5楼^#

发布于：2003-07-17 23:03

谢谢！
以前没有烧写CPLD的时候，PLXmon可以访问PCI9054的内部寄存器和外部局部总线，但是，烧写以后，只能访问内部寄存器不能访问外部局部总线。我烧写的内容中关于PCI9054（大部分的9054控制线都连在CPLD上了）的部分主要是LBE（0：3），LHOLD，LHOLDA，WAIT#，READY#。其他的只做输入管脚，因该不会对控制管脚产生影响？
请指教！

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