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求助，关于target一直反馈stop信号
在项目中想使用altera的megacore生成的PCI core，并使用自带的参考设计来做为local端。下载到altera公司的PCI的FPGA板卡中验证其PCI core的MASTER和TARGET功能。
在modelsim中的仿真都是正确的，但是当下载到FPGA当中，PCIcore作为target功能没有问题，并且master写没问题。但是读功能不正确，PCI core想把内存中的数据读出来，通过申请PCI总线，并得到总线授权，并且能够给总线AD和CBEN给出地址和命令，电脑端并能够响应DEVSEL,可就是电脑端主机内存不能给出所需要的数据，并且trdy信号一直无效，stop信号置低有效。这种情况是target的retry吗？是不是主机驱动哪里有问题，还是访问方式主机端不接受，导致出错呢？这个问题困扰我好久了 |
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