大家回贴呀!vhdl 与verilog hdl 那个有前途

arkzhu 驱动牛犊注册日期2002-12-02 最后登录2009-09-16 粉丝0 关注0 积分0分威望0点贡献值0点好评度0点原创分0分专家分0分加关注写私信	阅读：4353回复：22 大家回贴呀!vhdl 与verilog hdl 那个有前途楼主^# 更多只看楼主倒序阅读发布于：2002-12-13 13:04 回帖吧，俺分不够
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green_pine 驱动太牛注册日期2002-10-22 最后登录2019-06-10 粉丝3 关注0 积分48分威望599点贡献值1点好评度144点原创分0分专家分0分加关注写私信	沙发^# 发布于：2002-12-13 13:55 做好了，那个都有前途
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midwinter 驱动牛犊注册日期2002-11-26 最后登录2003-01-19 粉丝0 关注0 积分0分威望0点贡献值0点好评度0点原创分0分专家分0分加关注写私信	板凳^# 发布于：2002-12-13 16:25 现在越来越多的公司都改用VERILOG了，容易上手。
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vv6 驱动牛犊注册日期2002-03-01 最后登录2011-06-17 粉丝0 关注0 积分5分威望12点贡献值0点好评度1点原创分0分专家分0分加关注写私信	地板^# 发布于：2002-12-13 20:48 VERILOG象汇编 VHDL象C
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green_pine 驱动太牛注册日期2002-10-22 最后登录2019-06-10 粉丝3 关注0 积分48分威望599点贡献值1点好评度144点原创分0分专家分0分加关注写私信	地下室^# 发布于：2002-12-14 11:04 虽然没学过verilog，不过他才像c
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Gong_XG 驱动太牛注册日期2002-10-01 最后登录2010-11-25 粉丝0 关注0 积分313分威望46点贡献值0点好评度4点原创分0分专家分0分加关注写私信	5楼^# 发布于：2002-12-15 14:09 VERILOG象汇编 VHDL象C
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wolffy

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6楼^#

发布于：2002-12-15 16:41

Verilog好象无法进行系统级的描述吧。

我坐在石头上，石头有点烫，但烫的很舒服。

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asic_liu

驱动中牛

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7楼^#

发布于：2002-12-16 09:21

各有优势，目前任何一个不可能一统天下

家住虚无飘渺中，本与世间无相争。忽如一日刀兵起，笑傲江湖一狂生。

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yqused 驱动牛犊注册日期2002-12-23 最后登录2007-08-27 粉丝0 关注0 积分59分威望7点贡献值0点好评度5点原创分0分专家分0分加关注写私信	8楼^# 发布于：2002-12-24 10:27 VERILOG一般用于芯片级的设计，易于上手 VHDL一般用于系统级的设计，难度较大。
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cwj53061871

驱动老牛

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9楼^#

发布于：2002-12-27 13:32

VERILOG象汇编
VHDL象C

verilog 象C，更容易模块化!

毛主席说：自力更生，坚苦朴素

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motif

驱动牛犊

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10楼^#

发布于：2002-12-31 13:34

踏踏实实的学，不管是学哪种语言，都可以的。
Verilog语法上接近C，对于有C语言基础的人比较容易上手。今后的
趋势是用C/C++作硬件的设计，更确切的说是作系统设计，由开发工
具自动进行软硬件的划分，硬件部分在行为级描述，由开发工具进行
高层次综合（现在主流的IC设计方法还是在寄存器传输级用HDL进
行描述）。随着EDA工具的强大，及HDL开发方法的普及，IC设计门坎
也逐渐降低。我隐约觉得，以后也会有个什么IC蓝领的称谓。遂在此
压力下埋头去读书了。

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dragon_hn

驱动中牛

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11楼^#

发布于：2003-02-05 22:42

坚决反对说“VERILOG象汇编，VHDL象C ”。
应该是“VERILOG象C，VHDL象BASIC吧 ”

www.dragon-2008.com 欢迎交流

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stroll 驱动小牛注册日期2001-10-26 最后登录2007-06-08 粉丝0 关注0 积分161分威望17点贡献值0点好评度16点原创分0分专家分0分加关注写私信	12楼^# 发布于：2003-02-10 15:16 国内用vhdl国外用verilog。
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bradley

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13楼^#

发布于：2003-02-11 11:46

VERILOG象汇编
VHDL象C

说反了吧。

[b][color=blue]知我者谓我心忧，不知我者谓我何求。[/color][/b]

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uestclx

驱动牛犊

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14楼^#

发布于：2003-02-14 10:34

做什么都一样。做好了都可以。工具不是只有一种就可以得。
verlog 我觉得不像c 毕竟连大括号都不用。更象fortune

vhdl 象pascal和vb混合语言。
用起来在做行为级描述时都一样。
vhdl写起了会长一些。引用模块比较麻烦。
数据类型需要转换。
verlog赋值总是要加类型说明（很烦）但没有类型转换。
更接近硬件。

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Gong_XG 驱动太牛注册日期2002-10-01 最后登录2010-11-25 粉丝0 关注0 积分313分威望46点贡献值0点好评度4点原创分0分专家分0分加关注写私信	15楼^# 发布于：2003-02-22 12:55 艺不压身！！！
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huttu 驱动大牛注册日期2002-11-19 最后登录2016-01-09 粉丝0 关注0 积分2分威望25点贡献值0点好评度19点原创分0分专家分0分加关注写私信	16楼^# 发布于：2003-02-27 10:16 我学的是VHDL ;) ;)
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double

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17楼^#

发布于：2003-02-27 17:08

不管学什么最主要的是学精，不论做什么最主要的是专心，三心二意即是学再有前途的东西也是没用的。
所以建议踏踏实实去钻研，什么都可以，毕竟现在看差别不大，而且只是一种语言而已，不行将来再学新的，现在的人就要有活到老学到老的精神。

轻轻的我来了带给你欢乐悄悄的我走了带走你忧愁

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luorenfei 驱动小牛注册日期2003-02-17 最后登录2006-11-30 粉丝0 关注0 积分55分威望6点贡献值0点好评度5点原创分0分专家分0分加关注写私信	18楼^# 发布于：2003-03-04 11:52 真正有前途的不是vhdl和verilog,而是你自己！！！努力吧朋友！ :P
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Gong_XG 驱动太牛注册日期2002-10-01 最后登录2010-11-25 粉丝0 关注0 积分313分威望46点贡献值0点好评度4点原创分0分专家分0分加关注写私信	19楼^# 发布于：2003-03-04 22:40 支持，正学VHDL
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