huoxy
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CY7C68013:在SLWR上加一个低电平脉冲,则设备工作不正常(复位/产生新设备)

楼主#
更多 发布于:2004-01-06 09:39
CY7C68013工作于 Slave FIFO 模式。

DMA Write 正常。从主机通过EP2发向设备的数据,可以通过在 SLRD 加一系列的低电平脉冲读出去。

但是 DMA Read 不正常。计划通过EP6向主机返回数据,IFCFG = 11 已经选择Slave FIFO模式,SLCS = 0 ,FIFOADR = 10, FIFOFULL = 1,应该我已经选择了EP6 FIFO,而且缓冲区不满(还没有写任何数据),此时,如果我在 SLWR 引脚加低电平脉冲,则出现问题,有时在1->0出问题、有时在0->1出问题,在第一个低电平脉冲器件肯定会出问题,问题:有时是“设备被意外删除”、有时是“添加了一个不可识别的新设备,原设备还在,但如果应用程序操作原设备则系统重起”。

为了测试,我把 68013 与其他外围设备断开连接,把它的各个引脚通过过孔引了出来,如果手拿着一个电阻腿去碰各个引脚,碰别的引脚都没关系,唯独一碰 SLWR 引脚就会出现上述的问题。

我的电路板没有用多层板,只是双层,这有没有关系?
是不是我的低电平脉冲太宽的关系?
是不是芯片的问题?该芯片的PD.0引脚不能输出(OED = 0xFF)PD的其他引脚都可以。该芯片为样片。
好好学习,天天向上,做一个乖宝宝。
bunnyh
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沙发#
发布于:2004-01-06 12:22
SLOE呢? 是不是总为‘0’啊?
如果是,会强制SLAVE FIFO总是输出数据。

PORT D 再用16-bit SLAVE FIFO 方式时, 是FD的高八位
huoxy
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板凳#
发布于:2004-01-06 14:49
SLOE呢? 是不是总为‘0’啊?
如果是,会强制SLAVE FIFO总是输出数据。

PORT D 再用16-bit SLAVE FIFO 方式时, 是FD的高八位


SLOE 已经拉高。

所有的的端点都使用 8bit FIFO 方式,在 Port D . 1~7 可以正常输出的同时,唯独 Port D .0 不能输出, OED = 0xFF; 应该都设置位输出了吧。

如果把设备接入USB总线的时候 SLWR 接低电平,则系统提示说:“连接了一个不能识别的设备”。如果设备接入USB总线的时候 SLWR 接高电平,则系统可以正常识别此设备,然后就可以使用 EZ-USB Control Panel 下载我的程序了。
这就是说,如果SLWR接低电平,则缺省的设备也不能成功枚举,那位大侠能帮忙试一下,看看您的设备如果上电时SLWR为低,能否正常工作,我也好排除芯片出问题的可能。
好好学习,天天向上,做一个乖宝宝。
babyblue
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地板#
发布于:2004-01-06 14:59
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huoxy
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地下室#
发布于:2004-01-06 15:12
reserved pin没接地?


没有。
好好学习,天天向上,做一个乖宝宝。
huoxy
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5楼#
发布于:2004-01-07 08:41
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确实是这个问题,我真是太疏忽了。非常感谢。
好好学习,天天向上,做一个乖宝宝。
游客

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