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一个fpga中的fifo的问题
哪种fpga内部可以提供4路2k(16位)的fifo,速度要能够达到100M.
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沙发#
发布于：2004-10-13 00:15
看你用那个公司的了，自己算一算需要的ram多大，然后作4个fifo看看，速度一般都是可以的
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板凳#
发布于：2004-10-13 08:34
我想用altera的
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地板#
发布于：2004-10-15 23:42
稍微高端点的，stratix好贵的啊，呵呵。
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地下室#
发布于：2004-10-16 18:23
Cyclone系列贵吗?如果外部再用一个高速的FIFO器件,价格也不便宜啊.
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5楼#
发布于：2004-10-20 10:07
Cyclone的可以直接用里面的RAM块做你的FIFO了，2k 16bit很小啊。你可以看看它的资料，计算它的RAM块大小，然后选择一款合适的Cyclone系列芯片，价格好象不太贵啊。
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6楼#
发布于：2004-10-27 14:25
那是不是如果内部有n个bits的RAM,就可以做成n个bits的fifo呢?
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7楼#
发布于：2004-10-29 22:43
altera ram有几种类型
可以做成不同位宽的fifo 可以例华很多块ram，就可以用来作很多fifo了 不过具体应该看芯片的资料了 |
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8楼#
发布于：2004-10-29 22:43
altera ram有几种类型
可以做成不同位宽的fifo 可以例化很多块ram，就可以用来作很多fifo了 不过具体应该看芯片的资料了 |
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9楼#
发布于：2004-12-02 18:52
我一直很想知道，如果数据不多，有必要专门辟出FIFO吗？我现在是拿寄存器保存数据，功能是都实现了，但性能是不是一样呢？
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10楼#
发布于：2004-12-03 22:07
性能应当是差不多的，假如你存储的数据都是简单的数据位，并且一般只是取状态数据什么的，完全可以，用DSP取，或者直接在fpga里读取是可以的。
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11楼#
发布于：2004-12-04 11:20
性能应当是差不多的，假如你存储的数据都是简单的数据位，并且一般只是取状态数据什么的，完全可以，用DSP取，或者直接在fpga里读取是可以的。 能否详细解释一下如何通过寄存器实现dsp读取？谢谢了！ |
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12楼#
发布于：2004-12-04 11:21
我一直很想知道，如果数据不多，有必要专门辟出FIFO吗？我现在是拿寄存器保存数据，功能是都实现了，但性能是不是一样呢？ 能说说如何实现的么？ |
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13楼#
发布于：2004-12-04 20:10
用DSP读取FPGA里面D触发器的数据：
你在DSP里面定义一个地址指针：int *readdata=（volatile int *）0xffff01； DSP程序中：int data=*readdata；只要访问这个地址就可以了。 FPGA中，用DSP的地址线（高四位+低四位即可：a23 & a22 & a21 & a20 & !a3 &!a2 & !a1 & a0）、r/w、STRB用与非门做译码电路产生一个高电平脉冲做D触发器的读时钟或者D触发器的读使能（用DSP的h1/H3做读数据钟）。 用DSP读FPGA里面FIFO的数据也一样了，FPGA往FIFO里面写数据你自己应当知道了，数据满了让他产生一个脉冲电平给DSP的外部int，在DSP的ISR里面读数据，地址译码和上面一样。 这个够详细了吧，记得给分哦！！！！ |
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14楼#
发布于：2004-12-05 10:02
strb是什么？
不要笑我，刚学 |
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15楼#
发布于：2004-12-05 15:50
DSP 的STRB脚
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16楼#
发布于：2004-12-06 13:55
DSP 的STRB脚 tms320c6713没找到STRB |
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17楼#
发布于：2004-12-07 12:45
TI的C3X里STRB作用类似于CE信号。在C67里有相应的CE信号，其实C6713的外部接口更好做，它是提供通用接口，CE、WR、RD、OE都有（C3X只有STRB、R/W#）。不要拘泥于具体的信号形式，把芯片外部的接口时序看明白就可以设计CPLD/FPGA的逻辑。
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